JP2014171271A - Inverter and power conversion device mounted with the same - Google Patents
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Abstract
Description
本発明は、直流電力を交流電力に変換するインバータ、およびそれを搭載した電力変換装置に関する。 The present invention relates to an inverter that converts direct-current power into alternating-current power, and a power conversion device equipped with the inverter.
近年、太陽光発電システムが急速に普及している。太陽光発電システムでは、太陽電池モジュールで発電された電力を、効率よく利用するためのパワーコンディショナを設置する必要がある。パワーコンディショナには、直流電力を交流電力に変換するためのインバータが搭載される。太陽光発電システムでより多くの電力を得るには、太陽電池セルでのエネルギー変換効率の向上と、パワーコンディショナでの電力変換効率の向上が重要である。パワーコンディショナを系統につなぐためには、高調波及び、電力損失の少ないインバータが求められる。 In recent years, solar power generation systems are rapidly spreading. In the solar power generation system, it is necessary to install a power conditioner for efficiently using the power generated by the solar cell module. The power conditioner is equipped with an inverter for converting DC power into AC power. In order to obtain more power in the solar power generation system, it is important to improve the energy conversion efficiency in the solar battery cell and the power conversion efficiency in the power conditioner. In order to connect the power conditioner to the system, an inverter with less harmonics and power loss is required.
インバータには、多くの場合、電源電圧と接地電位との間でスイッチを直列接続した回路が含まれる。このような回路では、直列に接続されたスイッチが同時にオンとなると貫通電流が流れる危険性がある。したがって、直列に接続されたスイッチのオンオフを制御する際には、すべてのスイッチがオフとなる期間を設けるのが一般的である(たとえば特許文献1参照)。 The inverter often includes a circuit in which switches are connected in series between a power supply voltage and a ground potential. In such a circuit, there is a risk that a through current flows if the switches connected in series are simultaneously turned on. Therefore, when controlling on / off of switches connected in series, it is common to provide a period during which all switches are off (see, for example, Patent Document 1).
本発明はこうした状況に鑑みてなされたものであり、その目的は、スイッチング損失をさらに低減することによりインバータの電力変換効率を向上させる技術を提供することにある。 This invention is made | formed in view of such a condition, The objective is to provide the technique which improves the power conversion efficiency of an inverter by further reducing switching loss.
上記課題を解決するために、本発明のインバータは、擬似正弦波を発生させるための階調制御型のインバータであって、電圧の階調を形成するために設けられている複数のスイッチのうち、隣り合う階調電圧形成時に通電状態とすべきスイッチに対して、当該階調電圧間においてそのスイッチを連続して通電状態とする制御部を備える。 In order to solve the above problems, an inverter according to the present invention is a gradation control type inverter for generating a pseudo sine wave, and a plurality of switches provided for forming a gradation of voltage. For a switch that is to be energized when adjacent grayscale voltages are formed, a control unit is provided that continuously energizes the switch between the grayscale voltages.
本発明によれば、貫通電流の発生を回避しつつインバータの電力変換効率を向上させることができる。 ADVANTAGE OF THE INVENTION According to this invention, the power conversion efficiency of an inverter can be improved, avoiding generation | occurrence | production of a through current.
(実施の形態1)
図1は、本発明の実施の形態に係るインバータ200の回路構成を示す。ここでは説明の便宜上、直流電源部100および負荷300も描いているが、それらはインバータ200の構成要素には含まれない。インバータ200は、直流電源部100に含まれる複数の直流電源からの直流電力を交流電力に変換する。直流電源部100は、それぞれ電源電圧の異なる第1の直流電源V1、第2の直流電源V2および第3の直流電源V3とを含む。インバータ200は、第1のHブリッジ回路1000、第2のHブリッジ回路1002、第3のHブリッジ回路1004および制御部20を備える。制御部20は、それぞれの直流電源からの電源電圧と、2つの電源電圧の差分電圧(以下、「電位差」ともよぶ)を用いて、擬似正弦波を発生させる。
(Embodiment 1)
FIG. 1 shows a circuit configuration of an
複数のHブリッジ回路は、それぞれ電圧が異なる複数の直流電源ごとに設けられ、当該複数の直流電源のそれぞれから負荷300に順方向電圧および逆方向電圧を供給する。制御部20は、複数のHブリッジ回路を制御することにより擬似正弦波を発生させる。
The plurality of H bridge circuits are provided for each of a plurality of DC power supplies having different voltages, and supply a forward voltage and a reverse voltage to the
本実施の形態では、三種類の直流電源(第1の直流電源V1、第2の直流電源V2、第3の直流電源V3)が設けられるため、インバータ200には、三つのHブリッジ回路が設けられる。なお、第1の直流電源V1の電源電圧E1>第2の直流電源V2の電源電圧E2>第3の直流電源V3の電源電圧E3とする。
In this embodiment, since three types of DC power supplies (first DC power supply V1, second DC power supply V2, and third DC power supply V3) are provided, the
第1のHブリッジ回路1000は、第1の直流電源V1から負荷300に順方向電圧および逆方向電圧を供給する回路で、第1−1スイッチS11、第1−2スイッチS12、第1共通スイッチS3および第2共通スイッチS4を備える。第1−1スイッチS11および第1−2スイッチS12は、第1の直流電源V1の高電位側と負荷300との間に並列に設けられる。第1共通スイッチS3および第2共通スイッチS4は、第1の直流電源V1の低電位側と負荷300との間に並列に設けられる。
The first H-
より具体的には、第1−1スイッチS11は、第1の直流電源V1の高電位側端子と負荷300の高電位側端子とを結ぶ経路に挿入され、第1−2スイッチS12は、第1の直流電源V1の高電位側端子と負荷300の低電位側端子とを結ぶ経路に挿入される。第1共通スイッチS3は、第1の直流電源V1の低電位側端子と負荷300の高電位側端子とを結ぶ経路に挿入され、第2共通スイッチS4は、第1の直流電源V1の低電位側端子と負荷300の低電位側端子とを結ぶ経路に挿入される。
More specifically, the 1-1 switch S11 is inserted in a path connecting the high potential side terminal of the first DC power supply V1 and the high potential side terminal of the
第1のHブリッジ回路1000は、第1の直流電源V1から負荷300に順方向電圧を印加する場合、制御部20により第1−1スイッチS11および第2共通スイッチS4がオンに、第1−2スイッチS12および第1共通スイッチS3がオフに制御される。一方、第1の直流電源V1から負荷300に逆方向電圧を印加する場合、第1−1スイッチS11および第2共通スイッチS4がオフに、第1−2スイッチS12および第1共通スイッチS3がオンに制御される。
When the first
第2のHブリッジ回路1002は、第2の直流電源V2から負荷300に順方向電圧および逆方向電圧を供給するための回路であり、第2−1スイッチS21、第2−2スイッチS22、第1共通スイッチS3および第2共通スイッチS4を備える。第2−1スイッチS21および第2−2スイッチS22は、第2の直流電源V2の高電位側と負荷300との間に並列に設けられる。第1共通スイッチS3および第2共通スイッチS4は、第2の直流電源V2の低電位側と負荷300との間に並列に設けられる。
The second H-
第3のHブリッジ回路1004は、第3の直流電源V3から負荷300に順方向電圧および逆方向電圧を供給するための回路であり、第3−1スイッチS31、第3−2スイッチS32、第1共通スイッチS3および第2共通スイッチS4を備える。第3−1スイッチS31および第3−2スイッチS32は、第3の直流電源V3の高電位側と負荷300との間に並列に設けられる。第1共通スイッチS3および第2共通スイッチS4は、第3の直流電源V3の低電位側と負荷300との間に並列に設けられる。
The third H-
このように、第1のHブリッジ回路1000と、第2のHブリッジ回路1002と、第3のHブリッジ回路1004において、それらを構成する第1共通スイッチS3および第2共通スイッチS4が共通化されている。すなわち、3つのHブリッジ回路1000、1002、1004において、それらを形成する二本の低電位側経路が共通化されている。
As described above, in the first
本実施の形態では第1の直流電源V1、第2の直流電源V2および第3の直流電源V3の低電位側電圧を所定の固定電圧(たとえば、グラウンド電圧)とし、これらの低電位側の配線を共通化する。これにより、インバータ200に含まれるスイッチの数が減る。
In the present embodiment, the low potential side voltages of the first DC power supply V1, the second DC power supply V2, and the third DC power supply V3 are set to a predetermined fixed voltage (for example, ground voltage), and these low potential side wirings Make common. Thereby, the number of switches included in the
第2のHブリッジ回路1002に含まれる第2−1スイッチS21、第2−2スイッチS22、第1共通スイッチS3および第2共通スイッチS4の詳細な接続関係およびオンオフ動作と、第3のHブリッジ回路1004に含まれる第3−1スイッチS31、第3−2スイッチS32、第1共通スイッチS3および第2共通スイッチS4の詳細な接続関係およびオンオフ動作は、それぞれ、第1のHブリッジ回路1000に含まれる第1−1スイッチS11、第1−2スイッチS12、第1共通スイッチS3および第2共通スイッチS4の接続関係およびオンオフ動作と同様であるため、その説明を省略する。
Detailed connection relationship and on / off operation of the 2-1 switch S21, the 2-2 switch S22, the first common switch S3 and the second common switch S4 included in the second
第1−1スイッチS11、第1−2スイッチS12、第2−1スイッチS21、第2−2スイッチS22、第3−1スイッチS31、第3−2スイッチS32、第1共通スイッチS3および第2共通スイッチS4には、それぞれパワーMOSFET(Metal-Oxide-Semiconductor Field-Effect Transistor)、IGBT(Insulated Gate Bipolar Transistor)、GaNトランジスタ、SiC−FET等を採用することができる。なお、本実施の形態では、特に明示した場合を除き、スイッチはすべてNチャンネルパワーMOSFETである。 1-1 switch S11, 1-2 switch S12, 2-1 switch S21, 2-2 switch S22, 3-1 switch S31, 3-2 switch S32, first common switch S3 and second As the common switch S4, a power MOSFET (Metal-Oxide-Semiconductor Field-Effect Transistor), an IGBT (Insulated Gate Bipolar Transistor), a GaN transistor, a SiC-FET, or the like can be employed. In this embodiment, all the switches are N-channel power MOSFETs unless otherwise specified.
制御部20は、第1のHブリッジ回路1000、第2のHブリッジ回路1002および第3のHブリッジ回路1004を制御し、負荷300に供給される電圧を時分割に切り換え、擬似正弦波を発生させる。この電圧の数(本明細書では、「階調数」ともいう)が多いほど、滑らかな正弦波が生成できる。
The
三つの直流電源および三つのHブリッジ回路を用いるインバータ200は、正負合わせて六種類の電圧(E1,E2,E3,−E3,−E2,−E1)を生成し、負荷300に電圧を供給しない状態のゼロ電圧を加えると、七種類の電圧を生成する。本実施の形態では、さらに後述の方法により、直流電源およびHブリッジ回路を増やさずに別の六種類の電圧を生成する。したがって、合計十三種類の電圧を生成する。
The
以下、別の六種類の電圧の生成方法を説明する。制御部20は、第1のHブリッジ回路1000を形成する二本の高電位側経路および第2のHブリッジ回路1002を形成する二本の高電位側経路を有効とし、ならびに第1のHブリッジ回路1000を形成する二本の低電位側経路、第2のHブリッジ回路1002を形成する二本の低電位側経路および第3のHブリッジ回路1004のすべての経路を無効とすることにより、第1及び2のHブリッジ回路を形成する。すなわち、第1及び2のHブリッジ回路は、第1のHブリッジ回路1000の高電位側の半分と、第2のHブリッジ回路1002の高電位側の半分とを組み合わせた回路である。
Hereinafter, another six types of voltage generation methods will be described. The
当該第1及び2のHブリッジ回路は、第1の直流電源V1と第2の直流電源V2との電位差を、負荷300に対して順方向および逆方向に供給する回路で、第1−1スイッチS11、第1−2スイッチS12、第2−1スイッチS21および第2−2スイッチS22を含む。
The first and second H bridge circuits are circuits that supply a potential difference between the first DC power source V1 and the second DC power source V2 to the
第1及び2のHブリッジ回路は、前記の順方向に供給する場合、制御部20により第1−1スイッチS11および第2−2スイッチS22をオン、第1−2スイッチS12、第2−1スイッチS21をオフとする。一方、逆方向に供給する場合、第1−2スイッチS12および第2−1スイッチS21をオン、第1−1スイッチS11、第2−2スイッチS22をオフとする。
When the first and second H-bridge circuits are supplied in the forward direction, the
制御部20は、第1のHブリッジ回路1000を形成する二本の高電位側経路および第3のHブリッジ回路1004を形成する二本の高電位側経路を有効とし、ならびに第1のHブリッジ回路1000を形成する二本の低電位側経路、第3のHブリッジ回路1004を形成する二本の低電位側経路および第2のHブリッジ回路1002のすべての経路を無効とすることにより、第1及び3のHブリッジ回路を形成する。すなわち、第1及び3のHブリッジ回路は、第1のHブリッジ回路1000の高電位側の半分と、第3のHブリッジ回路1004の高電位側の半分とを組み合わせた回路である。
The
第1及び3のHブリッジ回路は、第1の直流電源V1と第3の直流電源V3との電位差を、負荷300に対して順方向および逆方向に供給する回路であり、第1−1スイッチS11、第1−2スイッチS12、第3−1スイッチS31および第3−2スイッチS32を含む。
The first and third H bridge circuits are circuits that supply a potential difference between the first DC power source V1 and the third DC power source V3 to the
制御部20は、第2のHブリッジ回路1002を形成する二本の高電位側経路および第3のHブリッジ回路1004を形成する二本の高電位側経路を有効とし、ならびに第2のHブリッジ回路1002を形成する二本の低電位側経路、第3のHブリッジ回路1004を形成する二本の低電位側経路および第1のHブリッジ回路1000のすべての経路を無効とすることにより、第2及び3のHブリッジ回路を形成する。すなわち、第2及び3のHブリッジ回路は、第2のHブリッジ回路1002の高電位側の半分と、第3のHブリッジ回路1004の高電位側の半分とを組み合わせた回路である。
The
第2及び3のHブリッジ回路は、第2の直流電源V2と第3の直流電源V3との電位差を、負荷300に対して順方向および逆方向に供給する回路であり、第2−1スイッチS21、第2−2スイッチS22、第3−1スイッチS31および第3−2スイッチS32を含む。
The second and third H bridge circuits are circuits that supply the potential difference between the second DC power source V2 and the third DC power source V3 to the
第1及び3のHブリッジ回路に含まれる第1−1スイッチS11、第1−2スイッチS12、第3−1スイッチS31および第3−2スイッチS32のオンオフ動作と、第2及び3のHブリッジ回路に含まれる第2−1スイッチS21、第2−2スイッチS22、第3−1スイッチS31および第3−2スイッチS32のオンオフ動作は、それぞれ、第1及び2のHブリッジ回路に含まれる第1−1スイッチS11、第1−2スイッチS12、第2−1スイッチS21および第2−2スイッチS22のオンオフ動作と同様であるため、その説明を省略する。 ON / OFF operation of the 1-1 switch S11, the 1-2 switch S12, the 3-1 switch S31, and the 3-2 switch S32 included in the first and 3 H bridge circuits, and the 2 and 3 H bridges ON / OFF operations of the 2-1 switch S21, the 2-2 switch S22, the 3-1 switch S31, and the 3-2 switch S32 included in the circuit are respectively included in the first and second H bridge circuits. Since this is the same as the on / off operation of the 1-1 switch S11, the 1-2 switch S12, the 2-1 switch S21, and the 2-2 switch S22, the description thereof is omitted.
以上のように、制御部20は、電源電圧E1、電源電圧E2、電源電圧E3、第1電位差(E1−E2)、第2電位差(E1−E3)、第3電位差(E2−E3)を用いて、十三種類の電圧を生成し、擬似正弦波を発生させる。
As described above, the
第2−1スイッチS21および第2−2スイッチS22は、第2のHブリッジ回路1002を形成するときと、第1及び2のHブリッジ回路を形成するときとで、電流の向きが変わる。また、第3−1スイッチS31および第3−2スイッチS32は、第3のHブリッジ回路1004を形成するときと、第1及び3のHブリッジ回路および第2及び3のHブリッジ回路を形成するときとで、電流の向きが変わる。つまり、第2−1スイッチS21、第2−2スイッチS22、第3−1スイッチS31および第3−2スイッチS32は、双方向に電流が流れる。したがって、第2−1スイッチS21、第2−2スイッチS22、第3−1スイッチS31および第3−2スイッチS32には、双方向スイッチング素子、たとえば、双方向に対応したパワーMOSFETまたはIGBTを用いる。または、単方向のパワーMOSFETまたはIGBTを、直列または並列にして一つの双方向スイッチング素子を構成してもよい。
In the 2-1 switch S21 and the 2-2 switch S22, the direction of the current is changed when the second
第1−1スイッチS11、第1−2スイッチS12、第1共通スイッチS3および第2共通スイッチS4は、一方向にしか電流が流れない。したがって、第1−1スイッチS11、第1−2スイッチS12、第1共通スイッチS3および第2共通スイッチS4には、一般的な単方向スイッチング素子を用いる。 The first-first switch S11, the first-second switch S12, the first common switch S3, and the second common switch S4 flow current in only one direction. Therefore, general unidirectional switching elements are used for the 1-1 switch S11, the 1-2 switch S12, the first common switch S3, and the second common switch S4.
図2は、本実施の形態のインバータ200の実装回路を示す。第1の直流電源V1の電源電圧E1を96V、第2の直流電源V2の電源電圧E2を82V、第3の直流電源V3の電源電圧E3を32Vに設定している。図1と比較すると、図2において、第1−1スイッチS11はスイッチSW0、第1−2スイッチS12はスイッチSW2、第1共通スイッチS3はスイッチSW1、第2共通スイッチS4はスイッチSW3、第2−1スイッチS21はスイッチSW4、SW5、第2−2スイッチS22はスイッチSW6、SW7、第3−1スイッチS31はスイッチSW8、SW9、第3−2スイッチS32はスイッチSW10、SW11に、それぞれ対応する。なお、図1においては、左から右方向を順方向としていたが、説明の便宜上、図2においては、右から左を順方向としている。
FIG. 2 shows a mounting circuit of the
図3は、図2に示すインバータ200により十三種類の階調レベルを生成する際の、スイッチのオンオフ状態を示す図である。階調レベル0はゼロ電圧、階調レベル1は電位差(E1−E2)(正)、階調レベル2は第3の直流電源V3の電圧E3(正)、階調レベル3は電位差(E2−E3)(正)、階調レベル4は電位差(E1−E3)(正)、階調レベル5は第2の直流電源V2の電圧E2(正)、階調レベル6は第1の直流電源V1の電圧E1(正)に、それぞれ対応する。制御部20は、図3に示すように、スイッチSW0〜SW11をオンオフ制御する。
FIG. 3 is a diagram showing an on / off state of the switch when the
なお、各スイッチSWには、ソースドレイン間に寄生ダイオードが存在している。図3においては、階調レベル1を生成する際のスイッチSW7、階調レベル2を生成する際のスイッチSW8、階調レベル3を生成する際のスイッチSW4およびスイッチSW11、階調レベル4を生成する際のスイッチSW11、階調レベル5を生成する際のスイッチSW4をオフにしているが、これは、わざわざオンにしなくても、寄生ダイオードを経由して電流が流れてくれるためである。
In each switch SW, a parasitic diode exists between the source and drain. In FIG. 3, a switch SW7 for generating
制御部20は、交流出力の位相0からπ/2までの間、すなわち1/4周期において、出力電圧を、ゼロ電圧、電位差(E1−E2)、電圧E3、電位差(E2−E3)、電位差(E1−E3)、電圧E2、電圧E1の順に変化させる。続いて制御部20は、交流出力の位相π/2からπまでの間、出力電圧を、電圧E1、電圧E2、電位差(E1−E3)、電位差(E2−E3)、電圧E3、電位差(E1−E2)、ゼロ電圧に変化させる。続いて制御部20は、交流出力の位相πから(3/2)πまでの間、出力電圧を、ゼロ電圧、電位差(E2−E1)、電圧(−E3)、電位差(E3−E2)、電位差(E3−E1)、電圧(−E2)、電圧(−E1)の順に変化させる。続いて制御部20は、交流出力の位相(3/2)πから2πまでの間、出力電圧を、電圧(−E1)、電圧(−E2)、電位差(E3−E1)、電位差(E3−E2)、電圧(−E3)、電位差(E2−E1)、ゼロ電圧に変化させる。
The
図4(a)〜(c)は、階調レベルを切り替える際のスイッチ動作を示す。図4(a)は、階調レベルを切り替える際にゲート電圧がオンからオフとなるべき、すなわちスイッチの状態がオンからオフとなるべき本実施の形態のあるスイッチのゲート電圧を表し、図4(b)は、階調レベルを切り替える際にゲート電圧がオフからオンとなるべき、すなわちスイッチ状態がオフからオンとなるべき(隣り合う階調電圧形成時に通電状態となるべき)本実施の形態のあるスイッチのゲート電圧を表し、図4(c)は、階調レベル切り替え前後で連続してゲート電圧がオンとなるべき、すなわち階調レベル切り替え前後で連続してスイッチがオンとなるべき(隣り合う階調電圧形成時に通電状態となるべき)本実施の形態のあるスイッチのゲート電圧を表している。図4において、Vgはゲート電圧を表し、Tdは階調レベル切り替え時において、すべてのスイッチがオフとなる期間を表している。また、Thdは、階調レベル切り替え時において、切り替え前後で連続してオンとなるべきスイッチについては一旦オフにすることなくオンのままで、その他のスイッチがオフとなる期間を表している。 FIGS. 4A to 4C show the switch operation when the gradation level is switched. 4A shows the gate voltage of a switch according to this embodiment in which the gate voltage should be turned off from on, that is, the switch state should be turned on from off when the gradation level is switched. (B) In the present embodiment, the gate voltage should be turned on from off when switching the gradation level, that is, the switch state should be turned on from off (turned on when adjacent gradation voltages are formed). 4 (c) shows that the gate voltage should be continuously turned on before and after the gradation level switching, that is, the switch should be continuously turned on before and after the gradation level switching ( This represents the gate voltage of a switch according to this embodiment (which should be in an energized state when adjacent gradation voltages are formed). In FIG. 4, Vg represents a gate voltage, and Td represents a period during which all switches are turned off at the time of gradation level switching. In addition, Thd represents a period during which the switches that should be continuously turned on before and after switching at the time of gradation level switching remain on without being turned off, and other switches are turned off.
一般に、電源電圧と接地電位との間で直列に接続されたスイッチを含む回路では、直列に接続されたスイッチが同時にオンとなると貫通電流が流れうる。したがって、こうしたスイッチを制御する際、すべてのスイッチがオフとなる期間を設けるのが一般的である。しかし、階調レベル切り替え前後で連続してオンとなるべきスイッチに対して、その切り替え時においてそのスイッチがオフとなるべき期間を設けなくても、他のスイッチがオフとなる期間を設けていれば、電源電圧と接地電位との間で直列に接続されたスイッチが同時にオンとなることはないため、貫通電流は防止できる。 In general, in a circuit including a switch connected in series between a power supply voltage and a ground potential, a through current can flow when the switches connected in series are simultaneously turned on. Therefore, when controlling these switches, it is common to provide a period during which all switches are off. However, for a switch that should be turned on continuously before and after the gradation level switching, there is a period during which the other switches are turned off even if there is no period during which the switch should be turned off. For example, since the switches connected in series between the power supply voltage and the ground potential are not turned on at the same time, a through current can be prevented.
その知見をもとに、階調レベル切り替え前後で連続してオンとなるべきスイッチについては、図4(c)に示すように、ゲート電圧をオンのままにして、その切り替え時においてそのスイッチがオフとなるべき時間をゼロとする。一方、他のスイッチについては、図4(a)および(b)に示すように、ゲート電圧をオフにしてその切り替え時においてそのスイッチがオフとなるべき期間を設ける。 Based on this knowledge, as shown in FIG. 4 (c), the switch that should be turned on continuously before and after the gradation level switching is kept on when the gate voltage is kept on. Set the time to turn off to zero. On the other hand, for the other switches, as shown in FIGS. 4A and 4B, the gate voltage is turned off, and a period in which the switch should be turned off at the time of switching is provided.
具体的には、図3に示すとおり、スイッチSW10は階調レベル3および階調レベル4で連続してオンとなるべき(隣り合う階調電圧形成時に通電状態となるべき)であるため、制御部20は、階調レベル3から階調レベル4への切り替え時および階調レベル4から階調レベル3への切り替え時において、スイッチSW10がオフとなるべき時間をゼロとする。また、スイッチSW3は階調レベル5および階調レベル6で連続してオンとなるべき(隣り合う階調電圧形成時に通電状態となるべき)であるため、制御部20は、階調レベル5から階調レベル6への切り替え時および階調レベル6から階調レベル5への切り替え時において、スイッチSW3がオフとなるべき時間をゼロとする。
Specifically, as shown in FIG. 3, the switch SW10 should be continuously turned on at
これによりインバータの電力変換効率が向上する。階調レベル切り替え時にすべてのスイッチに対してオフとなる期間を設ける場合と比べ、貫通電流を防止しつつもスイッチング回数を減らすことができ、スイッチング損失を低減することができるためである。 This improves the power conversion efficiency of the inverter. This is because the number of times of switching can be reduced and switching loss can be reduced while preventing a through current, compared with the case where a period in which all switches are turned off is provided at the time of gradation level switching.
本実施の形態では、インバータ200で使用される直流電源の数およびHブリッジ回路の数を三つに設定する例を説明した。この点、直流電源の数およびHブリッジ回路の数を二つに設定することも四つ以上設定することもできる。
In the present embodiment, the example in which the number of DC power supplies and the number of H bridge circuits used in the
本発明者は、よりスイッチング損失を低減すべく、階調レベル切り替え前後で連続してオンとなるべき(隣り合う階調電圧形成時に通電状態となるべき)スイッチの延べ数と直流電源との関係について考察した。以下、電源数が三つの場合での例(図5)を示しつつ、一般にn(nは2以上の整数)個の直流電源が使用される場合を示す。 In order to further reduce the switching loss, the present inventor relates to the relationship between the total number of switches that should be continuously turned on before and after the gradation level switching (to be energized when adjacent gradation voltages are formed) and the DC power supply. Considered. Hereinafter, an example (FIG. 5) in the case where the number of power supplies is three is shown, and a case where n (n is an integer of 2 or more) DC power supplies is generally used.
図5は、図2に示すインバータにより、階調レベルを0から6まで変化させて交流出力の位相0からπ/2までの擬似正弦波を生成する際のスイッチのオンオフ状態と、生成される擬似正弦波を示す図である。ここでは、階調レベル切り替え前後で連続してオンとなるべきスイッチが電源数と同じ延べ3個(点線で囲った箇所)となるよう各直流電源の電源電圧を設定したときのスイッチのオンオフ状態および生成される擬似正弦波が示される。図5では、第1の直流電源V1の電源電圧E1を96V、第2の直流電源V2の電源電圧E2を64V、第3の直流電源V3の電源電圧E3を14Vに設定している。
FIG. 5 shows an ON / OFF state of the switch when the gray level is changed from 0 to 6 to generate a pseudo sine wave from
階調レベル切り替え前後で連続して同じスイッチがオンとなるのは、隣り合う階調レベルで正負も同じ向きで同じ電圧を負荷に印加する場合である。したがって、次の(1)および(2)条件を満たすように各直流電源の電源電圧を設定すれば、階調レベルが0から6に遷移する交流出力の位相0からπ/2までの1/4周期において、隣り合う階調レベルで正負同じ向きで同じ電圧が使用される箇所をn箇所以上設けることができ、その結果、階調レベル切り替え前後で連続してオンとなるべきスイッチを延べn個以上設けることができる。
The same switch is continuously turned on before and after the gradation level switching when the same voltage is applied to the load in the same direction in the adjacent gradation levels. Therefore, if the power supply voltage of each DC power supply is set so as to satisfy the following conditions (1) and (2), the AC output phase where the gradation level transitions from 0 to 6 is reduced to 1 / from the
(1)最低電圧の直流電源を除く各直流電源について、各直流電源の電源電圧と、その直流電源の電源電圧と最低電圧の直流電源の電源電圧との差分電圧が、それぞれ隣り合う階調レベルとなる。 (1) For each DC power supply except the lowest voltage DC power supply, the power supply voltage of each DC power supply and the differential voltage between the power supply voltage of the DC power supply and the power supply voltage of the lowest voltage DC power supply are adjacent to each other. It becomes.
この条件を満たすことにより、最低電圧の直流電源を除くn−1個の直流電源の電源電圧を正負同じ向きで隣り合う階調レベルで使用すること、すなわち、正負も同じ向きで同じ直流電源の電源電圧が使用される箇所をn−1箇所設けることができる。 By satisfying this condition, the power supply voltages of n-1 DC power supplies excluding the DC power supply with the lowest voltage are used at adjacent gradation levels in the same direction of positive and negative, that is, the same DC power supply in the same direction. It is possible to provide n-1 places where the power supply voltage is used.
図5では、最低電圧の直流電源である第3の直流電源V3を除く第1の直流電源V1および第2の直流電源V2について、第1の直流電源V1の電源電圧E1と、電源電圧E1と最低電圧の電源電圧E3との電位差(E1−E3)とが隣り合う階調レベル(階調レベル6と階調レベル5)で使用されており、第2の直流電源V2の電源電圧E2と、電源電圧E2と最低電圧の電源電圧E3との電位差(E2−E3)とが隣り合う階調レベル(階調レベル3と階調レベル4)で使用されている。すなわち、正負も同じ向きで同じ直流電源の電源電圧が使用される箇所が2箇所(実線で囲った箇所)設けられている。
In FIG. 5, for the first DC power supply V1 and the second DC power supply V2 except the third DC power supply V3 which is the lowest voltage DC power supply, the power supply voltage E1 of the first DC power supply V1, the power supply voltage E1 and The potential difference (E1-E3) with the lowest power supply voltage E3 is used at adjacent gradation levels (
(2)最低電圧の直流電源の電源電圧とゼロ電圧が隣り合う階調レベルとなる。 (2) The power supply voltage of the lowest DC power supply and the zero voltage are adjacent gradation levels.
この条件を満たすことにより、ゼロ電圧を隣り合う階調レベルで使用することができ、正負も同じ向きで同じ電圧が使用される箇所をさらに1箇所設けることができる。 By satisfying this condition, it is possible to use zero voltage at adjacent gradation levels, and it is possible to provide one more place where the same voltage is used in the same direction as positive and negative.
図5では、最低電圧の直流電源である第3の直流電源V3の電源電圧E3(E3−0)とゼロ電圧(0−0)とが隣り合う階調レベルで使用されている(一点鎖線で囲った箇所)。 In FIG. 5, the power supply voltage E3 (E3-0) and the zero voltage (0-0) of the third DC power supply V3, which is the DC power supply with the lowest voltage, are used at adjacent gradation levels (in a one-dot chain line). Enclosed area).
なお、上記の例では階調レベル0から6に遷移する交流出力の位相0からπ/2までの間について、階調レベル切り替え前後で連続してオンとなるべきスイッチを延べn個以上設けられることを説明したが、π/2からπまでの間、πから(3/2)πまでの間、(3/2)πからπまでの間についても、それぞれ、n箇所以上設けることができる。
In the above example, a total of n or more switches that should be continuously turned on before and after the gradation level switching are provided between the
(実施の形態2)
本実施の形態では、インバータを搭載したパワーコンディショナを含む太陽光発電システムについて説明する。本実施の形態において、上述の実施の形態1と同一部分には同一符号を付して詳細な説明は省略する。
(Embodiment 2)
In the present embodiment, a solar power generation system including a power conditioner equipped with an inverter will be described. In the present embodiment, the same parts as those in the first embodiment are denoted by the same reference numerals, and detailed description thereof is omitted.
図6は、本実施の形態に係るインバータ200を搭載したパワーコンディショナ210を含む太陽光発電システム500のシステム構成を示す。太陽光発電システム500は、太陽電池モジュール100a、接続箱100bおよびパワーコンディショナ210を備える。パワーコンディショナ210は直流電力を交流電力に変換する電力変換装置として機能する。
FIG. 6 shows a system configuration of a photovoltaic
太陽電池モジュール100aは、複数の太陽光パネルを含み、建物の屋根などに設置される。太陽電池モジュール100aは、太陽光を直流電力に変換して接続箱100bに出力する。
The
接続箱100bは、太陽電池モジュール100aに含まれる複数の太陽光パネルからの配線をまとめる。接続箱100bは、本実施の形態に係るインバータ200で使用される直流電源の数に応じた複数の直流電圧を、パワーコンディショナ210に供給する。複数の太陽光パネルから当該複数の直流電圧を直接取得できる場合、そのままパワーコンディショナ400に供給することができる。複数の太陽光パネルから当該複数の直流電圧のすべてを取得できない場合、昇圧回路を用いて直接取得できない直流電圧を生成する。
The
パワーコンディショナ210は、本実施の形態に係るインバータ200、およびフィルタ205を備える。インバータ200は、接続箱100bから供給される複数の直流電圧を用いて、擬似正弦波を生成する。フィルタ205は、インバータ200により生成された擬似正弦波を平滑化する。
The
インバータ200で、より滑らかな正弦波を生成する場合、階調数を増やす、すなわち、インバータ200で使用される直流電源の数およびHブリッジ回路の数を増やす必要がある。ただし、インバータ200で滑らかな正弦波が生成されるほど、後段のフィルタ205の強度を低くすることができる。
When the
パワーコンディショナ210により生成された交流電力は、負荷300に供給される。たとえば、家庭用の太陽光発電システム500では、分電盤を通じて、家庭内の電気機器に供給されるか、送電線網に供給される。
The AC power generated by the
以上、本実施の形態に係るインバータ200を、太陽光発電システム500用のパワーコンディショナ210に適用することにより、エネルギー変換効率の高い太陽光発電システム500を構築することができる。
As described above, by applying the
(実施の形態3)
本実施の形態では、階調数を増やすことなく擬似正弦波を滑らかにする手法と、インバータへの電圧供給に適した電源システムについて説明する。本実施の形態において、上述の実施の形態1と同一部分には同一符号を付して詳細な説明は省略する。なお、本実施の形態のインバータ200は、実施の形態1と同様、図1に示す構成を有する。
(Embodiment 3)
In this embodiment, a method for smoothing a pseudo sine wave without increasing the number of gradations and a power supply system suitable for supplying voltage to an inverter will be described. In the present embodiment, the same parts as those in the first embodiment are denoted by the same reference numerals, and detailed description thereof is omitted. Note that the
図1の制御部20は、擬似正弦波を構成する少なくとも一つの階調を、その階調の電圧およびその隣りの階調の電圧をハイレベルおよびローレベルとするPWM(Pulse Width Modulation)信号を発生させ、インバータ200を構成する各スイッチに供給する。すなわち、階調レベル1と階調レベル2、階調レベル2と階調レベル3といったように、隣り合う階調レベルの印加電圧間を往復することによりPWM信号を生成することができる。各階調をPWM信号で表現れば、擬似正弦波はより滑らかになる。
The
各階調をPWM信号で表現した場合、すなわち、隣り合う階調レベル間を繰り返し往復する場合、階調レベル切り替え前後で連続してオンとなるべきスイッチに対して、その切り替え時においてそのスイッチがオフとなるべき時間をゼロとすることによる、スイッチング損失の低減の効果は大きくなる。 When each gradation is expressed by a PWM signal, that is, when reciprocating between adjacent gradation levels repeatedly, the switch that is to be turned on continuously before and after the gradation level switching is turned off at the time of switching. The effect of reducing the switching loss is increased by setting the time to be zero to zero.
本実施の形態のインバータ200に供給する各電圧の生成に適した電源システム100cについて説明する。なお、以下の説明では実施の形態1における電圧E1を高電圧HV、電圧E2を中電圧MVおよび電圧E3を低電圧LVと表記する。
A
図7は、本実施の形態のインバータ200への電圧供給に適した電源システム100cを説明するための図である。電源システム100cには、直流電源(たとえば、太陽電池またはリチウムイオン、ニッケル水素、鉛などの二次電池)から一種類の直流電圧が供給される。電源システム100cは、この直流電圧をもとに高電圧HV、中電圧MVおよび低電圧LVを生成する。電源システム100cは、第1電源装置101(「HV電源装置」ともいう)、第2電源装置102(「MV電源装置」ともいう)および第3電源装置103(「LV電源装置」ともいう)の三つの電源装置を備える。
FIG. 7 is a diagram for explaining a
第1電源装置101、第2電源装置102および第3電源装置103はそれぞれ、高電圧HV、中電圧MV、低電圧LVを生成し、インバータ200に供給する。以下、高電圧HV、中電圧MVおよび低電圧LVはそれぞれ48V、41Vおよび16Vとする。
The first
第1電源装置101および第2電源装置102は、昇圧型DC−DCコンバータ(「昇圧チョッパ」ともいう)を含む、一般的な電源装置で構成される。第3電源装置103の構成は後述する。
The first
図8は、本実施の形態のインバータ200により生成された擬似正弦波を示す。高電圧HV:中電圧MV:低電圧LV=48V:41V:16V=3:2.56:1である。低電圧LVに維持されるべきノードには、高電圧HVおよび中電圧MVの系統から電流が流れこむ(図8の斜線部参照)。すなわち、平均すれば流入電流>流出電流の関係になる。中電圧MVに維持されるべきノードにも、高電圧HVの系統から電流が流入するが、接地GND及び低電圧LVに維持されるべきノードに電流を流出するため、一周期で平均すると流入電流<流出電流の関係になる。
FIG. 8 shows a pseudo sine wave generated by the
図9は、第3電源装置103の基本回路構成を示す。第3電源装置103は、比較器CP1および昇圧型DC−DCコンバータ10を備える。比較器CP1は、中電圧MVの系統から電流が流入するノードの電圧と、そのノードを低電圧LVに維持するための参照電圧Vrefとを比較する。
FIG. 9 shows a basic circuit configuration of the third
図9の回路構成では、比較器CP1はオペアンプで構成され、その非反転入力端子に上記ノードの電圧が印加され、その反転入力端子に参照電圧Vrefが印加される。当該ノードの電圧が参照電圧Vrefを超えるときハイレベル信号を出力し、超えないときローレベル信号を出力する。 In the circuit configuration of FIG. 9, the comparator CP1 is composed of an operational amplifier, the voltage of the node is applied to its non-inverting input terminal, and the reference voltage Vref is applied to its inverting input terminal. A high level signal is output when the voltage of the node exceeds the reference voltage Vref, and a low level signal is output when the voltage does not exceed the reference voltage Vref.
昇圧型DC−DCコンバータ10は、比較器CP1に入力されるノードの電圧を受け、当該電圧を中電圧MVより高い電圧に昇圧し、中電圧MVの系統に印加する。昇圧型DC−DCコンバータ10は、比較器CP1による比較の結果、当該ノードの電圧が参照電圧Vrefより高いとき昇圧機能を有効化し、当該ノードの電圧が参照電圧Vref以下のとき昇圧機能を無効化する。図9の回路構成では、比較器CP1からハイレベル信号が入力されると、昇圧型DC−DCコンバータ10の昇圧機能が有効化し、ローレベル信号が入力されると、無効化される。
The step-up DC-
昇圧型DC−DCコンバータ10により昇圧された電圧が、第2電源装置102の出力系統に印加されることにより、低電圧LVに維持されるべきノードに蓄積される電荷が中電圧MVの系統に戻される。そのためには、昇圧型DC−DCコンバータ10が中電圧MV(本設定例41V)を超える電圧まで昇圧し、昇圧型DC−DCコンバータ10から第2電源装置102の出力系統に電流を流す必要がある。
The voltage boosted by the step-up DC-
図10は、第3電源装置103の回路構成例を示す。第3電源装置103は、比較器CP1、可変抵抗器VR、昇圧型DC−DCコンバータ10、パルス発生器11、ANDゲート12およびフォトカプラ13を含む。
FIG. 10 shows a circuit configuration example of the third
比較器CP1の反転入力端子に印加される参照電圧Vrefは、図10に示す回路構成の電源電圧(たとえば、5V)を図示しない抵抗分割により生成され、たとえば、2.5Vに設定される。低電圧LVは可変抵抗器VRにより抵抗分割されて、比較器CP1の非反転入力端子に印加される。可変抵抗器VRは、低電圧LVが理想値のとき参照電圧Vrefと一致するように抵抗分割する。 The reference voltage Vref applied to the inverting input terminal of the comparator CP1 is generated by resistance division (not shown) of the power supply voltage (for example, 5V) having the circuit configuration shown in FIG. 10, and is set to 2.5V, for example. The low voltage LV is resistance-divided by the variable resistor VR and applied to the non-inverting input terminal of the comparator CP1. The variable resistor VR divides the resistance so that it matches the reference voltage Vref when the low voltage LV is an ideal value.
パルス発生器11(たとえば、ファンクションジェネレータ)は、パルス信号を生成する。ANDゲート12は、パルス発生器11により生成されるパルス信号と、比較器CP1から出力される比較結果信号(イネーブル信号として利用される)を受ける。
The pulse generator 11 (for example, a function generator) generates a pulse signal. The AND
ANDゲート12は、比較器CP1の出力信号がハイレベルのとき、パルス発生器11の出力信号をそのまま出力し、比較器CP1の出力信号がローレベルのとき、ローレベルを出力する。ANDゲート12の出力信号は、フォトカプラ13を介して後述するスイッチング素子M1に入力される。
The AND
このように、ANDゲート12は、上記ノードの電圧(より厳密には可変抵抗器VRにより分割された低電圧VL)が参照電圧Vrefより高いとき、パルス信号をスイッチング素子M1に供給し、当該ノードの電圧が参照電圧Vref以下のときスイッチング素子M1にオフ信号(ローレベル)を供給する。
Thus, the AND
昇圧型DC−DCコンバータ10は、インダクタL1、ダイオードD1、スイッチング素子M1、第1キャパシタC1および第2キャパシタC2を含む。インダクタL1とダイオードD1の直列回路は、電流が流入するノード(低電圧LVを維持するよう制御されている)に接続される入力端子と、電流を流出している中電圧MVの系統に接続される出力端子との間に設けられる。
The step-up DC-
スイッチング素子M1は、インダクタL1とダイオードD1の接続点と、所定の固定電位(図10では、グラウンド)との間に設けられる。スイッチング素子M1にパルス信号が入力されると、昇圧型DC−DCコンバータ10は昇圧動作を開始し、オフ信号が入力されると停止する。
The switching element M1 is provided between a connection point between the inductor L1 and the diode D1 and a predetermined fixed potential (ground in FIG. 10). When a pulse signal is input to the switching element M1, the step-up DC-
第1キャパシタC1は、昇圧型DC−DCコンバータ10の入力端子と当該固定電位との設けられ、当該入力端子の電圧を平滑化する。第2キャパシタC2は、昇圧型DC−DCコンバータ10の出力端子と当該固定電位との間に設けられ、当該出力端子の電圧を平滑化する。
The first capacitor C1 is provided with the input terminal of the step-up DC-
以上、第3電源装置103は、昇圧型DC−DCコンバータの入力側を利用して電流が流入するノードの電圧を一定に保ちつつ、その昇圧機能を利用して余分な電荷を流出元に還流させて、無駄な消費電力の発生を抑制することができる。
As described above, the third
すなわち、当該ノードへの電荷の流入により当該ノードの電位が上昇し、参照電位を上回ると比較器の出力が有意なレベル(上述した例ではハイレベル)に反転する。これにより、昇圧型DC−DCコンバータが起動する。すなわち、比較器の出力は昇圧型DC−DCコンバータのイネーブル信号となる。 That is, the potential of the node rises due to the inflow of electric charge to the node, and the output of the comparator is inverted to a significant level (high level in the above example) when the potential exceeds the reference potential. As a result, the step-up DC-DC converter is activated. In other words, the output of the comparator is an enable signal for the step-up DC-DC converter.
昇圧型DC−DCコンバータの動作開始により、昇圧型DC−DCコンバータの出力電圧が上記流出元の電圧を超えると、当該流出元に電流が流れ、上記ノードの電位が低下する。そのノードの電位が比較器の参照電位を下回ると、昇圧型DC−DCコンバータの動作が停止する。したがって、当該ノードの電位を一定に保つことができる。また、当該ノードに余分に蓄積される電荷は、流出元に還元されるため、原理的には無駄な消費電力がまったく発生しないことになる。 When the output voltage of the step-up DC-DC converter exceeds the source voltage due to the start of the operation of the step-up DC-DC converter, a current flows through the source and the potential of the node decreases. When the potential of the node falls below the reference potential of the comparator, the operation of the step-up DC-DC converter is stopped. Therefore, the potential of the node can be kept constant. Further, since the extra charge accumulated in the node is reduced to the outflow source, in principle, useless power consumption does not occur at all.
図11は、図9に示した第3電源装置103の回路構成と比較すべき回路構成を示す図である。この比較例に係る第3電源装置103cも、電流が流入するノードの電位を一定に保つことができる。当該第3電源装置103cは、比較器CP1cおよびスイッチング素子M1cおよび抵抗Rcを含む。
FIG. 11 is a diagram illustrating a circuit configuration to be compared with the circuit configuration of the third
比較器CP1cに入力される電圧は、図11に示した回路構成と同じである。比較器CP1cの出力端子は、スイッチング素子M1cの制御端子に接続される。スイッチング素子M1cの入力端子は上記ノードに接続され、その出力端子は抵抗Rcを介して接地される。 The voltage input to the comparator CP1c is the same as the circuit configuration shown in FIG. The output terminal of the comparator CP1c is connected to the control terminal of the switching element M1c. The input terminal of the switching element M1c is connected to the above node, and the output terminal thereof is grounded via the resistor Rc.
当該ノードに余分な電荷が流入すると、スイッチング素子M1cがオンし、当該電荷が抵抗Rcに流れ、ジュール熱として放出される。このように、図11の回路構成と図9の回路構成を比較すると、前者が無駄なエネルギーを消費しており、後者では原理的にエネルギーロスが発生しないことが分かる。 When excess charge flows into the node, the switching element M1c is turned on, the charge flows to the resistor Rc, and is released as Joule heat. Thus, comparing the circuit configuration of FIG. 11 with the circuit configuration of FIG. 9, it can be seen that the former consumes wasted energy and that the latter does not generate energy loss in principle.
以上、本発明を実施の形態をもとに説明した。この実施の形態は例示であり、それらの各構成要素や各処理プロセスの組合せにいろいろな変形例が可能なこと、またそうした変形例も本発明の範囲にあることは当業者に理解されるところである。 The present invention has been described based on the embodiments. This embodiment is an exemplification, and it will be understood by those skilled in the art that various modifications can be made to combinations of the respective constituent elements and processing processes, and such modifications are also within the scope of the present invention. is there.
実施の形態では、インバータ200に含まれるすべてのHブリッジの回路の低電位側の経路を共通化する例を説明したが、共通化しない回路構成も本発明に含まれる。また、すべてのHブリッジ回路の低電位側経路の一部を共通化し、残りを共通化しない回路構成も本発明に含まれる。
In the embodiment, the example in which the paths on the low potential side of all the H-bridge circuits included in the
実施の形態に係るインバータ200を太陽光発電システム500用のパワーコンディショナ210に適用する例を説明したが、それに限定されることになく、瞬低保護装置、無停電電源装置(Uninterruptible Power Supply:UPS)、その他の装置にも適用可能である。
Although an example in which the
100 直流電源部、 200 インバータ、 V1 第1の直流電源、 V2 第2の直流電源、 V3 第3の直流電源、 S11 第1−1スイッチ、 S12 第1−2スイッチ、 S21 第2−1スイッチ、 S22 第2−2スイッチ、 S31 第3−1スイッチ、 S32 第3−2スイッチ、 S3 第1共通スイッチ、 S4 第2共通スイッチ、 20 制御部、 100a 太陽電池モジュール、 100b 接続箱、 205 フィルタ、 210 パワーコンディショナ、 300 負荷、 500 太陽光発電システム。 100 DC power supply unit, 200 inverter, V1 first DC power supply, V2 second DC power supply, V3 third DC power supply, S11 1-1 switch, S12 1-2 switch, S21 1-2 switch, S22 2-2 switch, S31 3-1 switch, S32 3-2 switch, S3 first common switch, S4 second common switch, 20 control unit, 100a solar cell module, 100b junction box, 205 filter, 210 Power conditioner, 300 load, 500 solar power generation system.
Claims (3)
電圧の階調を形成するために設けられている複数のスイッチのうち、隣り合う階調電圧形成時に通電状態とすべきスイッチに対して、当該階調電圧間においてそのスイッチを連続して通電状態とする制御部を備えることを特徴とするインバータ。 A gradation control type inverter for generating a pseudo sine wave,
Among a plurality of switches provided to form voltage gradations, a switch that is to be energized when adjacent gradation voltages are formed is continuously energized between the gradation voltages. An inverter comprising a control unit.
Priority Applications (2)
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