JP7174672B2 - switching power supply - Google Patents
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Description
本発明は、レーザダイオード等の各種負荷に予め定められた電流を供給するスイッチング電源装置に関する。 The present invention relates to a switching power supply that supplies predetermined currents to various loads such as laser diodes.
従来、レーザダイオード等の各種負荷に予め定められた電流を供給する電源装置として、特許文献1に記載のものが知られている。この電源装置は、スイッチングコンバータ(一例としてCukコンバータ)と、該コンバータに含まれる1つのスイッチング素子を制御するコンバータコントローラとを備えている。この電源装置では、コントローラがスイッチング素子をオン/オフさせることにより、負荷に流れる電流が予め定められた上限値および下限値の間で往復する。つまり、この電源装置では、スイッチング素子のオン/オフにより、負荷に流れる電流がほぼ一定に保たれる。
2. Description of the Related Art Conventionally, as a power supply device that supplies a predetermined current to various loads such as a laser diode, the one described in
コンバータの形式は、直列に接続されたP型のスイッチング素子およびN型のスイッチング素子を交互にオン/オフさせるものであってもよいし、直列に接続された2つのN型のスイッチング素子を交互にオン/オフさせるものであってもよい。N型のスイッチング素子は、P型のスイッチング素子よりもオン抵抗が小さい。このため、後者のコンバータによれば、スイッチング損失を低減することができる。なお、後者のコンバータを使用する場合は、高電位側のN型のスイッチング素子をオンさせるために、コントローラにブートストラップ機能を設けておく必要がある。 The form of the converter may alternately turn on/off a P-type switching element and an N-type switching element connected in series, or alternately turn on/off two N-type switching elements connected in series. may be turned on/off at the same time. An N-type switching element has a lower on-resistance than a P-type switching element. Therefore, the latter converter can reduce switching loss. When using the latter converter, it is necessary to provide the controller with a bootstrap function in order to turn on the N-type switching element on the high potential side.
ところで、近年、各種電気機器において、高速起動のニーズが高まっている。しかしながら、上記後者のコンバータを含む電源装置では、低電位側のN型のスイッチング素子をオンさせてブートストラップ回路のコンデンサを充電した後でないと高電位側のN型のスイッチング素子をオンさせることができないため、負荷への電流の供給がその分だけ遅れるという問題があった。 By the way, in recent years, there is an increasing need for high-speed start-up in various electric devices. However, in the power supply device including the latter converter, the N-type switching element on the high potential side can be turned on only after the N-type switching element on the low potential side is turned on to charge the capacitor of the bootstrap circuit. Therefore, there is a problem that the current supply to the load is delayed by that amount.
本発明は上記事情に鑑みてなされたものであって、その課題とするところは、従来よりも負荷を高速起動させることができるスイッチング電源装置を提供することにある。 SUMMARY OF THE INVENTION The present invention has been made in view of the above circumstances, and an object of the present invention is to provide a switching power supply device capable of starting a load at a higher speed than the conventional one.
上記課題を解決するために、本発明に係るスイッチング電源装置は、直列に接続されたN型の高電位側スイッチング素子およびN型の低電位側スイッチング素子によって負荷を駆動するものであって、高電位側スイッチング素子をオン/オフさせるための第1駆動信号および低電位側スイッチング素子をオン/オフさせるための第2駆動信号を出力するブートストラップ機能付きの駆動回路部と、負荷に流れている電流に基づいて、第1駆動信号の元になる第1制御信号および第2駆動信号の元になる第2制御信号を駆動回路部に与える制御回路部とを備え、制御回路部には、イネーブル信号と、上記電流の上限値および下限値の両方に関係する1つの外部設定信号とが外部から与えられ、制御回路部は、(1)イネーブル信号が第1状態であるときに、上記電流が上限値を上回ろうとすると、第1制御信号および第2制御信号によって高電位側スイッチング素子がオフし、かつ低電位側スイッチング素子がオンした第1スイッチ状態を作り出し、上記電流が下限値を下回ろうとすると、第1制御信号および第2制御信号によって高電位側スイッチング素子がオンし、かつ低電位側スイッチング素子がオフした第2スイッチ状態を作り出し、(2)イネーブル信号が上記第1状態とは異なる第2状態であるときに、第1制御信号および第2制御信号によって上記電流とは無関係に第1スイッチ状態を作り出す、との構成を有している。 In order to solve the above problems, a switching power supply device according to the present invention drives a load by an N-type high-potential side switching element and an N-type low-potential side switching element connected in series. A drive circuit unit with a bootstrap function that outputs a first drive signal for turning on/off the potential side switching element and a second drive signal for turning on/off the low potential side switching element, and a load flowing to the a control circuit unit that provides the drive circuit unit with a first control signal that is the source of the first drive signal and a second control signal that is the source of the second drive signal, based on the current; A signal and an external setting signal related to both the upper and lower limits of the current are provided externally, and the control circuitry is provided with: (1) when the enable signal is in the first state, the current is When the upper limit value is about to be exceeded, the first control signal and the second control signal turn off the high potential side switching element and turn on the low potential side switching element to create a first switch state, and the current falls below the lower limit value. When about to turn, the first control signal and the second control signal create a second switch state in which the high potential side switching element is turned on and the low potential side switching element is turned off, and (2) the enable signal is in the first state. is in a different second state, the first control signal and the second control signal create the first switch state independently of the current.
この構成によれば、ユーザによる動作開始の操作(起動指令)に応じてイネーブル信号が第2状態から第1状態に変化するようにしておくことで、動作開始の直後から負荷に流れる電流を増加させることができ、負荷を素早く起動させることができる。また、この構成によれば、外部設定信号を変更するだけで、電流の上限値および下限値の両方を変更することができる。 According to this configuration, the enable signal is changed from the second state to the first state in accordance with the user's operation start operation (activation command), thereby increasing the current flowing through the load immediately after the operation starts. and the load can be activated quickly. Moreover, according to this configuration, both the upper limit value and the lower limit value of the current can be changed simply by changing the external setting signal.
上記スイッチング電源装置の制御回路部は、例えば、外部設定信号の分圧により、上限値に対応する上限設定信号および下限値に対応する下限設定信号を生成する上下限信号生成部と、上記電流に応じた電流検出信号を出力する電流検出部と、上限設定信号と電流検出信号とを比較するとともに該比較の結果に応じた第1比較結果信号を出力する第1比較部と、下限設定信号と電流検出信号とを比較するとともに該比較の結果に応じた第2比較結果信号を出力する第2比較部と、第1比較結果信号および第2比較結果信号のうちの一方がセット信号として入力されるとともに他方がリセット信号として入力されるRSフリップフロップ部とを備え、RSフリップフロップ部が出力するQ信号および反転Q信号のうちの一方が第1制御信号として駆動回路部に与えられるとともに他方が第2制御信号として駆動回路部に与えられる、との構成を有していてもよい。 The control circuit unit of the switching power supply includes, for example, an upper/lower limit signal generation unit that generates an upper limit setting signal corresponding to an upper limit value and a lower limit setting signal corresponding to a lower limit value by voltage division of an external setting signal; a current detection unit that outputs a current detection signal corresponding to the current detection signal; a first comparison unit that compares the upper limit setting signal and the current detection signal and outputs a first comparison result signal according to the result of the comparison; and a lower limit setting signal. a second comparison unit that compares the current detection signal and outputs a second comparison result signal according to the result of the comparison; and one of the first comparison result signal and the second comparison result signal is input as a set signal. and an RS flip-flop section to which the other is input as a reset signal, one of the Q signal and the inverted Q signal output by the RS flip-flop section is provided to the drive circuit section as a first control signal, and the other is provided to the drive circuit section. It may have a configuration in which it is given to the drive circuit section as the second control signal.
また、上記スイッチング電源装置は、制御回路部が、Q信号の立ち上がりを遅らせることにより遅延Q信号を生成するとともに反転Q信号の立ち上がりを遅らせることにより遅延反転Q信号を生成する遅延部をさらに備え、Q信号および反転Q信号の代わりに遅延Q信号および遅延反転Q信号が駆動回路部に与えられるよう構成されていることが好ましい。 In the switching power supply, the control circuit section further includes a delay section for generating a delayed Q signal by delaying the rising of the Q signal and generating a delayed inverted Q signal by delaying the rising of the inverted Q signal, Preferably, the delayed Q signal and the delayed inverted Q signal are applied to the driving circuit section instead of the Q signal and the inverted Q signal.
この構成によれば、高電位側スイッチング素子および低電位側スイッチング素子が同時にオン状態となるのを防ぐことができる。 According to this configuration, it is possible to prevent the high potential side switching element and the low potential side switching element from being turned on at the same time.
本発明によれば、従来よりも負荷を高速起動させることができるスイッチング電源装置を提供することができる。 According to the present invention, it is possible to provide a switching power supply device capable of starting a load at a higher speed than the conventional one.
以下、添付図面を参照しながら、本発明に係るスイッチング電源装置の実施例について説明する。 Embodiments of a switching power supply device according to the present invention will be described below with reference to the accompanying drawings.
[第1実施例]
図1に、本発明の第1実施例に係るスイッチング電源装置10Aを示す。スイッチング電源装置10Aは、負荷30としてのプロジェクタ装置の光源(レーザダイオード)に予め定められた電流を供給する同期整流型の降圧コンバータであり、同図に示すように、ブートストラップ機能を有する駆動回路部11と、スイッチング回路部12と、フィルタ回路部13と、制御回路部14Aとを備えている。
[First embodiment]
FIG. 1 shows a switching
スイッチング回路部12は、直列に接続されたN型の高電位側スイッチング素子Q1およびN型の低電位側スイッチング素子Q2を含んでいる。本実施例において、スイッチング素子Q1,Q2は、MOSFET(Metal Oxide Semiconductor Field Effect Transistor)である。スイッチング素子Q1,Q2は、駆動回路部11に駆動されて交互にオンする。つまり、スイッチング回路部12は、高電位側スイッチング素子Q1がオフし、かつ低電位側スイッチング素子Q2がオンした第1スイッチ状態と、高電位側スイッチング素子Q1がオンし、かつ低電位側スイッチング素子Q2がオフした第2スイッチ状態とをとり得る。
The
スイッチング回路部12は、さらに、高電位側スイッチング素子Q1のゲートに接続された抵抗R1と、低電位側スイッチング素子Q2のゲートに接続された抵抗R2とを備えている。これらは、スイッチング素子Q1,Q2を最適に駆動するための抵抗である。
The
駆動回路部11は、駆動部18と、ダイオードD1と、コンデンサC1とを含んでいる。本実施例では、駆動部18として、富士電機製のハイサイド・ローサイドドライバIC「FA5650N」を使用した。
The
駆動部18は、8つの端子(HIN,LIN,GND,LO,VCC,VS,HO,VB)を有している。VCC端子は、直流電源VCCおよびダイオードD1のアノードに接続され、端子VBは、ダイオードD1のカソードおよびコンデンサC1の一端に接続され、VS端子は、コンデンサC1の他端に接続されている。HO,LO端子は、抵抗R1,R2に接続され、VS端子は、スイッチング素子Q1,Q2の接続点Mにも接続されている。GND端子は、接地されている。また、HIN,LIN端子は、制御回路部14Aに接続されている。
The
図2に示すように、駆動部18は、HIN端子から入力される第1制御信号を波形整形およびレベルシフトさせながら後段に伝達するドライバDRVHと、ドライバDRVHから伝達されてきた信号を第1駆動信号としてHO端子から出力する電流増幅器AMPHとを備えている。ドライバDRVHおよび電流増幅器AMPHは、VB端子およびVS端子の電位差を電源電圧として動作する。
As shown in FIG. 2, the
駆動部18は、さらに、LIN端子から入力される第2制御信号を波形整形しながら後段に伝達するドライバDRVLと、ドライバDRVLから伝達されてきた信号を第2駆動信号としてLO端子から出力する電流増幅器AMPLとを備えている。ドライバDRVLおよび電流増幅器AMPLは、VCC端子およびGND端子の電位差(すなわち、直流電源VCCの出力電圧)を電源電圧として動作する。
The
図3に示すように、LIN端子にHレベルの第2制御信号が入力されると、LO端子からHレベルの第2駆動信号が出力され、低電位側スイッチング素子Q2がオンし、直流電源VCC→ダイオードD1→コンデンサC1→低電位側スイッチング素子Q2→GNDの電流経路が形成され、コンデンサC1が充電される。そして、その結果、VB端子の電位がVS端子の電位よりも高くなり、ドライバDRVHおよび電流増幅器AMPHは、第1制御信号に対応した第1駆動信号を出力することができるようになる。この状態で、HIN端子にHレベルの第1制御信号が入力されると、HO端子からHレベルの第1駆動信号が出力され、高電位側スイッチング素子Q1がオンする。 As shown in FIG. 3, when the second control signal of H level is input to the LIN terminal, the second drive signal of H level is output from the LO terminal, the low potential side switching element Q2 is turned on, and the DC power supply is turned on. A current path of VCC→diode D 1 →capacitor C 1 →low potential side switching element Q 2 →GND is formed, and the capacitor C 1 is charged. As a result, the potential of the VB terminal becomes higher than the potential of the VS terminal, and the driver DRVH and the current amplifier AMPH can output the first drive signal corresponding to the first control signal. In this state, when the H level first control signal is input to the HIN terminal, the H level first drive signal is output from the HO terminal, turning on the high potential side switching element Q1 .
再び図1を参照する。フィルタ回路部13は、スイッチング素子Q1,Q2の接続点Mに一端が接続されたインダクタL1と、インダクタL1の他端に一端が接続されたコンデンサC2とを含んでいる。また、コンデンサC2の他端は、接地されている。
Refer to FIG. 1 again. The
負荷30としてのレーザダイオードは、コンデンサC2に対して並列に接続される。
A laser diode as
スイッチング回路部12が、高電位側スイッチング素子Q1がオンし、かつ低電位側スイッチング素子Q2がオフした第2スイッチ状態をとると、直流電源HV→高電位側スイッチング素子Q1→インダクタL1→コンデンサC2→GNDの経路でコンデンサC2が充電される。そして、これにより、負荷30に印加される電圧が上昇し、負荷電流ILが増加する。
When the
一方、スイッチング回路部12が、高電位側スイッチング素子Q1がオフし、かつ低電位側スイッチング素子Q2がオンした第1スイッチ状態をとると、インダクタL1に蓄えられたエネルギーが、コンデンサC2→GND→低電位側スイッチング素子Q2の経路で放電する。そして、これにより、負荷30に印加される電圧が低下し、負荷電流ILが減少する。
On the other hand, when the
制御回路部14Aは、電流検出部15と、比較部16と、RSフリップフロップ部17とを含んでいる。また、制御回路部14Aには、プロジェクタ装置全体の動作を制御する不図示の制御装置から2つの信号(イネーブル信号SENおよび外部設定信号SSET)が与えられるようになっている。
The
電流検出部15は、負荷電流ILの経路に介装された抵抗R3と、差動増幅器AMP1と、抵抗R3の一端および差動増幅器AMP1の反転入力(-)に接続された抵抗R4と、差動増幅器AMP1の出力および反転入力に接続された抵抗R6と、抵抗R3の他端および差動増幅器AMP1の非反転入力(+)に接続された抵抗R5と、差動増幅器AMP1の非反転入力およびGNDに接続された抵抗R7とを有している。また、差動増幅器AMP1の非反転入力には、ダイオードを介してイネーブル信号SENが入力される。
The
Lレベルのイネーブル信号SENが入力されているとき、電流検出部15は、抵抗R3の一端および他端の電位差を抵抗R4,R5,R6,R7の抵抗値によって決まる増幅率αで増幅してなる電流検出信号SILを出力する。すなわち、電流検出部15は、負荷電流ILに比例した電流検出信号SILを出力する。一方、Hレベルのイネーブル信号SENが入力されているとき、電流検出部15は、負荷電流ILに比例しない、大きな電流検出信号SILを出力する。
When the L-level enable signal S EN is input, the
このように、Hレベルのイネーブル信号SENは、差動増幅器AMP1の非反転入力に影響を与える。すなわち、Hレベルのイネーブル信号SENは、電流検出信号SILを負荷電流ILに比例しない別の値に強制的に変化させる。本発明では、このような効果を生じさせるイネーブル信号SENの状態(本実施例では、Hレベル)を「第2状態」と呼ぶ。一方、Lレベルのイネーブル信号SENは、差動増幅器AMP1の非反転入力に影響を与えない。すなわち、Lレベルのイネーブル信号SENは、電流検出部15が負荷電流ILに比例した電流検出信号SILを出力することを妨げない。本発明では、このような効果を生じさせるイネーブル信号SENの状態(本実施例では、Lレベル)を「第1状態」と呼ぶ。
Thus, the H level enable signal S EN affects the non-inverting input of the differential amplifier AMP 1 . That is, the H-level enable signal S EN forcibly changes the current detection signal S IL to another value that is not proportional to the load current IL. In the present invention, the state of the enable signal S EN (H level in this embodiment) that produces such an effect is called a "second state". On the other hand, the L level enable signal S EN does not affect the non-inverting input of the differential amplifier AMP 1 . That is, the L -level enable signal S EN does not prevent the
比較部16は、本発明の「上下限信号生成部」を構成する抵抗R8、抵抗R9および抵抗R10を有している。抵抗R8,R9,R10は、外部設定信号SSETを分圧することにより、上限設定信号SSETHおよび下限設定信号SSETL(ただし、SSETH>SSETL)を生成する。
The
比較部16は、本発明の「第1比較部」に相当する第1比較器COMP1を有している。第1比較器COMP1は、反転入力に入力された電流検出信号SILと非反転入力に入力された上限設定信号SSETHとを比較する。そして、第1比較器COMP1は、電流検出信号SILの方が小さければHレベルの第1比較結果信号SRを出力し、上限設定信号SSETHの方が小さいか両者が等しければLレベルの第1比較結果信号SRを出力する。
The
比較部16は、さらに、本発明の「第2比較部」に相当する第2比較器COMP2を有している。第2比較器COMP2は、非反転入力に入力された電流検出信号SILと反転入力に入力された下限設定信号SSETLとを比較する。そして、第2比較器COMP2は、電流検出信号SILの方が大きければHレベルの第2比較結果信号SSを出力し、下限設定信号SSETLの方が大きいか両者が等しければLレベルの第2比較結果信号SSを出力する。
The
ここで、電流検出信号SIL、上限設定信号SSETHおよび下限設定信号SSETLは、次式で表すことができる。
SIL=α×R3×IL
SSETH=SSET×(R9+R10)/(R8+R9+R10) ・・・(1)
SSETL=SSET×R10/(R8+R9+R10) ・・・(2)
また、負荷電流ILが上限値であるILHになったときに電流検出信号SILと上限設定信号SSETHとが一致して第1比較結果信号SRの極性が反転すること、および負荷電流ILが下限値であるILLになったときに電流検出信号SILと下限設定信号SSETLとが一致して第2比較結果信号SSの極性が反転することから、次式が成立する。
SSET×(R9+R10)/(R8+R9+R10)=α×R3×ILH
SSET×R10/(R8+R9+R10)=α×R3×ILL
したがって、上限値ILHと下限値ILLとの差であるヒステリシス幅IWは、次式で表すことができる。
IW=ILH-ILL
=SSET×(R9+R10)/(R8+R9+R10)/(α×R3)
-SSET×R10/(R8+R9+R10)/(α×R3)
=SSET×R9/(R8+R9+R10)/(α×R3) ・・・(3)
Here, the current detection signal S IL , upper limit setting signal S SETH and lower limit setting signal S SETL can be expressed by the following equations.
S IL = α×R 3 ×IL
SSETH = SSET *( R9 + R10 )/ ( R8+R9+ R10 ) ( 1 )
SSETL = SSET *R10/ ( R8+ R9 + R10 ) ( 2 )
Further, when the load current I L reaches the upper limit value I LH , the current detection signal S IL matches the upper limit setting signal S SETH and the polarity of the first comparison result signal S R is reversed. When the current I L reaches the lower limit I LL , the current detection signal S IL matches the lower limit setting signal S SETL and the polarity of the second comparison result signal S S is reversed. do.
S SET ×(R 9 +R 10 )/(R 8 +R 9 +R 10 )=α×R 3 × ILH
S SET ×R 10 /(R 8 +R 9 +R 10 )=α×R 3 × ILL
Therefore, the hysteresis width IW , which is the difference between the upper limit value I LH and the lower limit value I LL , can be expressed by the following equation.
I W = I LH - I LL
=S SET ×(R 9 +R 10 )/(R 8 +R 9 +R 10 )/(α×R 3 )
−S SET ×R 10 /(R 8 +R 9 +R 10 )/(α×R 3 )
=S SET ×R 9 /(R 8 +R 9 +R 10 )/(α×R 3 ) (3)
上の(1)式、(2)式および(3)式は、外部設定信号SSETの電圧を変更するだけで、上限値ILHに対応する上限設定信号SSETH、下限値ILLに対応する下限設定信号SSETL、およびヒステリシス幅IWを任意に変更することができることを示している。 The above equations (1), (2) and (3) correspond to the upper limit setting signal S SETH corresponding to the upper limit value I LH and the lower limit value I LL simply by changing the voltage of the external setting signal S SET . It shows that the lower limit setting signal S SETL and the hysteresis width I W can be arbitrarily changed.
RSフリップフロップ部17は、第1論理和器OR1と、第2論理和器OR2とを有している。第1論理和器OR1には、第1比較器COMP1から出力された第1比較結果信号SRと第2論理和器OR2から出力されたQ信号SQとが入力される。また、第2論理和器OR2には、第2比較器COMP2から出力された第2比較結果信号SSと第1論理和器OR1から出力された反転Q信号SQBとが入力される。なお、第1比較結果信号SRは、RSフリップフロップ部17のリセット信号であり、第2比較結果信号SSは、RSフリップフロップ部17のセット信号であると言える。
The RS flip-
第1論理和器OR1が出力した反転Q信号SQBは、第2制御信号として駆動部18のLIN端子に与えられる。また、第2論理和器OR2が出力したQ信号SQは、第1制御信号として駆動部18のHIN端子に与えられる。
The inverted Q signal S QB output from the first logical adder OR 1 is applied to the LIN terminal of the driving
続いて、図4を参照しながら、スイッチング電源装置10Aの動作の一例について説明する。
Next, an example of the operation of the switching
(時刻t0:電源投入)
プロジェクタ装置の電源が投入されると、前述の制御装置からHレベル(第2状態)のイネーブル信号SENが入力される。これにより、“SIL>SSETH>SSETL”の関係が成立し、駆動部18がLレベルの第1駆動信号およびHレベルの第2駆動信号を出力し、その結果、スイッチング回路部12が第1スイッチ状態(高電位側スイッチング素子Q1がオフ、低電位側スイッチング素子Q2がオン)をとり、コンデンサC1が充電される。
(Time t 0 : power on)
When the power of the projector is turned on, the H level (second state) enable signal S EN is input from the aforementioned control device. As a result, the relationship “S IL >S SETH >S SETL ” is established, and the driving
(時刻t1:動作開始)
ユーザが動作開始の操作を行うと、前述の制御装置からLレベル(第1状態)のイネーブル信号SENが入力される。これにより、“SSETH>SSETL>SIL”の関係が成立し、駆動部18がHレベルの第1駆動信号およびLレベルの第2駆動信号を出力し、その結果、スイッチング回路部12が第2スイッチ状態(高電位側スイッチング素子Q1がオン、低電位側スイッチング素子Q2がオフ)をとり、コンデンサC2が充電され、負荷電流ILが増加し始める。負荷電流ILが増加すると、電流検出信号SILも増加する。
(Time t 1 : Start of operation)
When the user performs an operation start operation, an L-level (first state) enable signal S EN is input from the aforementioned control device. As a result, the relationship “S SETH >S SETL >S IL ” is established, and the driving
(時刻t2:電流検出信号SILが下限設定信号SSETLに達する)
電流検出信号SILが増加して下限設定信号SSETLに達すると、セット信号としての第2比較結果信号SSの極性が反転(Lレベル→Hレベル)するが、第1駆動信号および第2駆動信号の極性は変化しないので、スイッチング回路部12は第2スイッチ状態をとり続ける。
(Time t2: Current detection signal SIL reaches lower limit setting signal SSETL )
When the current detection signal S IL increases and reaches the lower limit setting signal S SETL , the polarity of the second comparison result signal S S as the set signal is reversed (from L level to H level). Since the polarity of the drive signal does not change, the switching
(時刻t3:電流検出信号SILが上限設定信号SSETHに達する)
電流検出信号SILがさらに増加して上限設定信号SSETHに達すると、リセット信号としての第1比較結果信号SRの極性が反転(Hレベル→Lレベル)するとともに、第1駆動信号および第2駆動信号の極性も反転し、その結果、スイッチング回路部12が第1スイッチ状態をとる。
(Time t 3 : Current detection signal S IL reaches upper limit setting signal S SETH )
When the current detection signal S IL further increases and reaches the upper limit setting signal S SETH , the polarity of the first comparison result signal S R as a reset signal is inverted (H level→L level), and the first drive signal and the first 2, the polarity of the drive signal is also inverted, and as a result, the switching
スイッチング回路部12が第1スイッチ状態をとると、負荷電流ILおよび電流検出信号SILが減少に転じ、“SSETH>SIL>SSETL”の関係が成立し、リセット信号としての第1比較結果信号SRの極性が再び反転(Lレベル→Hレベル)する。この2回目の反転によっては、第1駆動信号および第2駆動信号の極性は変化しないので、スイッチング回路部12は第1スイッチ状態をとり続ける。
When the
第1比較結果信号SRがLレベルとなる時間は非常に短い。したがって、制御回路部14Aは、負荷電流ILが上限設定信号SSETHを上回ろうとしたときに第1スイッチ状態を作り出したとも言える。
The time during which the first comparison result signal S R is at L level is very short. Therefore, it can be said that the
(時刻t4:電流検出信号SILが下限設定信号SSETLに達する)
電流検出信号SILがさらに減少して下限設定信号SSETLに達すると、セット信号としての第2比較結果信号SSの極性が反転(Hレベル→Lレベル)するとともに、第1駆動信号および第2駆動信号の極性も反転し、その結果、スイッチング回路部12が第2スイッチ状態をとる。
( Time t4: Current detection signal SIL reaches lower limit setting signal SSETL )
When the current detection signal S IL further decreases and reaches the lower limit setting signal S SETL , the polarity of the second comparison result signal S S as the set signal is inverted (H level→L level), and the first drive signal and the first drive signal S are inverted. 2, the polarity of the drive signal is also inverted, and as a result, the switching
スイッチング回路部12が第2スイッチ状態をとると、負荷電流ILおよび電流検出信号SILが増加に転じ、“SSETH>SIL>SSETL”の関係が成立し、セット信号としての第2比較結果信号SSの極性が再び反転(Lレベル→Hレベル)する。この2回目の反転によっては、第1駆動信号および第2駆動信号の極性は変化しないので、スイッチング回路部12は第2スイッチ状態をとり続ける。
When the
第2比較結果信号SSがLレベルとなる時間は非常に短い。したがって、制御回路部14Aは、負荷電流ILが下限設定信号SSETLを下回ろうとしたときに第2スイッチ状態を作り出したとも言える。
The time during which the second comparison result signal S S is at L level is very short. Therefore, it can be said that the
(時刻t5:動作停止)
ユーザが動作停止の操作を行うと、前述の制御装置からHレベル(第2状態)のイネーブル信号SENが入力される。これにより、“SIL>SSETH>SSETL”の関係が成立し、スイッチング回路部12が第1スイッチ状態をとり、負荷電流ILおよび電流検出信号SILが減少していく。
(Time t 5 : Operation stopped)
When the user performs an operation to stop the operation, an H level (second state) enable signal S EN is input from the aforementioned control device. As a result, the relationship "S IL >S SETH >S SETL "is established, the switching
このように、本実施例に係るスイッチング電源装置10Aでは、Hレベルのイネーブル信号SENが入力されると、負荷電流ILとは無関係にスイッチング回路部12が第1スイッチ状態とされ、ブートストラップ機能に関わるコンデンサC1が充電される。したがって、スイッチング電源装置10Aによれば、ユーザが動作開始の操作を行ったときにイネーブル信号SENがHレベルからLレベルに変化するようにしておくことで、動作開始の直後から負荷電流ILを増加させることができ、負荷30としてのレーザダイオードを素早く点灯(起動)させることができる。
As described above, in the switching
なお、ユーザがレーザダイオードの輝度に関する設定を変更すると、前述の制御装置から入力される外部設定信号SSETが変化するが、本実施例に係るスイッチング電源装置10Aは、この変化にも素早く追従することができる。
When the user changes the setting related to the luminance of the laser diode, the external setting signal S SET input from the above-described control device changes, but the switching
すなわち、スイッチング電源装置10Aは、電流検出信号SILが減少している最中に外部設定信号SSETが変化して上限設定信号SSETHおよび下限設定信号SSETLが変動した場合(図5(A),(D)参照)、および電流検出信号SILが増加している最中に外部設定信号SSETが変化して上限設定信号SSETHおよび下限設定信号SSETLが変動した場合(図5(B),(C)参照)のいずれにおいても、変動後の範囲内に収まるように電流検出信号SIL(負荷電流IL)を素早く変化させることができる。
That is, the switching
[第2実施例]
図6に、本発明の第2実施例に係るスイッチング電源装置10Bを示す。スイッチング電源装置10Bは、遅延部19をさらに含む制御回路部14Bを備えている点においてスイッチング電源装置10Aと相違しているが、他の点においてはスイッチング電源装置10Aと共通している。
[Second embodiment]
FIG. 6 shows a switching
遅延部19は、第1論理和器OR1の出力に一端が接続されるとともに駆動部18のLIN端子に他端が接続された抵抗R11と、抵抗R11の一端にカソードが接続されるとともに抵抗R11の他端にアノードが接続されたダイオードD2と、抵抗R11の他端に一端が接続されるとともに他端が接地されたコンデンサC3と有している。抵抗R11、ダイオードD2およびコンデンサC3は、反転Q信号SQBの立ち上がりを遅らせることにより、遅延反転Q信号SQB’を生成する。
The delay unit 19 has a resistor R11, one end of which is connected to the output of the first logical adder OR1 and the other end of which is connected to the LIN terminal of the driving
遅延部19は、さらに、第2論理和器OR2の出力に一端が接続されるとともに駆動部18のHIN端子に他端が接続された抵抗R12と、抵抗R12の一端にカソードが接続されるとともに抵抗R12の他端にアノードが接続されたダイオードD3と、抵抗R12の他端に一端が接続されるとともに他端が接地されたコンデンサC4と有している。抵抗R12、ダイオードD3およびコンデンサC4は、Q信号SQの立ち上がりを遅らせることにより、遅延Q信号SQ’を生成する。
The
図7に、遅延前後のQ信号SQ,SQ’、遅延前後の反転Q信号SQB,SQB’、高電位側スイッチング素子Q1のための第1駆動信号および低電位側スイッチング素子Q2のための第2駆動信号を示す。この図から明らかなように、本実施例に係るスイッチング電源装置10Bによれば、高電位側スイッチング素子Q1および低電位側スイッチング素子Q2が同時にオン状態となるのを回避して、直流電源HVからGNDに大電流が流れるのを防ぐことができる。
FIG. 7 shows the Q signals S Q and S Q ' before and after the delay, the inverted Q signals S QB and S QB ' before and after the delay, the first drive signal for the high potential side switching element Q 1 and the low potential side switching element Q. 2 shows a second drive signal for . As is clear from this figure, according to the switching
[第3実施例]
図8に、本発明の第3実施例に係るスイッチング電源装置10Cを示す。スイッチング電源装置10Cは、比較部16およびRSフリップフロップ部17の代わりにヒステリシス付き比較部20を含む制御回路部14Cを備えている点においてスイッチング電源装置10Aと相違しているが、他の点においてはスイッチング電源装置10Aと共通している。
[Third embodiment]
FIG. 8 shows a switching
ヒステリシス付き比較部20は、差動増幅器AMP2と、外部設定信号SSETを分圧する抵抗R13および抵抗R14と、帰還抵抗である抵抗R15とを有している。差動増幅器AMP2の反転入力には、電流検出信号SILが入力される。差動増幅器AMP2の非反転入力は、抵抗R13,R14の中点に接続されるとともに、抵抗R15の一端に接続されている。また、抵抗R15の他端は、差動増幅器AMP2の出力に接続されている。差動増幅器AMP2および抵抗R13,R14,R15は、ヒステリシス付きのコンパレータとして動作する。 The comparison unit 20 with hysteresis has a differential amplifier AMP2, resistors R13 and R14 for dividing the external setting signal SSET , and a resistor R15 as a feedback resistor. A current detection signal S IL is input to the inverting input of the differential amplifier AMP 2 . A non - inverting input of the differential amplifier AMP2 is connected to the midpoint of the resistors R13 and R14 and to one end of the resistor R15 . Also, the other end of the resistor R15 is connected to the output of the differential amplifier AMP2. Differential amplifier AMP2 and resistors R13 , R14 , R15 operate as a comparator with hysteresis.
ヒステリシス付き比較部20は、論理否定器INVと、論理肯定器BUFとをさらに有している。論理否定器INVは、差動増幅器AMP2から出力された信号から反転Q信号SQBを生成する。一方、論理肯定器BUFは、差動増幅器AMP2から出力された信号からQ信号SQを生成する。
The comparator with
本実施例に係るスイッチング電源装置10Cによれば、第1実施例と同様、外部設定信号SSETの電圧を変更するだけで、上限値ILHと下限値ILLを任意に変更し、負荷電流ILをその範囲内に収めることができる。ただし、スイッチング電源装置10Cでは、ヒステリシス幅IWを任意に変更することはできない。したがって、ヒステリシス幅IWを含む3つの要素を任意に変更したい場合は、第1実施例を採用すべきである。
According to the switching
なお、図9に示す比較例に係るスイッチング電源装置100のように、制御回路部101を構成するヒステリシス付き比較部20の抵抗R14を直流電源VCCに接続すると、外部から上限値ILHおよび下限値ILLを任意に変更することができなくなるため注意が必要である。第1実施例および第2実施例において抵抗R8を直流電源VCCに接続した場合も同様である。
As in the switching
[変形例]
以上、本発明に係るスイッチング電源装置の第1実施例および第2実施例について説明してきたが、本発明の構成はこれらに限定されるものではない。
[Modification]
Although the first and second embodiments of the switching power supply device according to the present invention have been described above, the configuration of the present invention is not limited to these.
例えば、制御回路部14A,14B,14Cは、以下の(1)~(3)のように振る舞う任意の回路であってもよい。
(1)外部から入力されるイネーブル信号SENが第1状態(例えば、Lレベル)であるときに負荷電流ILが上限値ILHを上回ろうとすると、第1制御信号および第2制御信号によってスイッチング回路部12を第1スイッチ状態とする。
(2)外部から入力されるイネーブル信号SENが第1状態(例えば、Lレベル)であるときに負荷電流ILが下限値ILLを下回ろうとすると、第1制御信号および第2制御信号によってスイッチング回路部12を第2スイッチ状態とする。
(3)外部から入力されるイネーブル信号SENが第2状態(例えば、Hレベル)であるときに、負荷電流ILの如何に依らず、第1制御信号および第2制御信号によってスイッチング回路部12を第1スイッチ状態とする。
ここで、第1状態は、Hレベルであってもよく、第2状態は、Lレベルであってもよい。また、イネーブル信号SENが周期的に変化する信号である場合は、周波数および振幅等によって第1状態と第2状態とが区別されてもよい。
For example, the
(1) When the externally input enable signal S EN is in the first state (for example, L level) and the load current I L tries to exceed the upper limit value I LH , the first control signal and the second control signal puts the
(2) When the load current I L tends to fall below the lower limit value I LL when the externally input enable signal S EN is in the first state (for example, L level), the first control signal and the second control signal puts the
(3) When the externally input enable signal S EN is in the second state (for example, H level), the switching circuit section is controlled by the first control signal and the second control signal regardless of the load current I L . 12 is the first switch state.
Here, the first state may be H level, and the second state may be L level. Further, when the enable signal S EN is a signal that changes periodically, the first state and the second state may be distinguished by frequency, amplitude, and the like.
また、第3実施例に係るスイッチング電源装置10Cの制御回路部14Cは、遅延部19(図6参照)をさらに含んでいてもよい。
Also, the
また、負荷30は、プロジェクタ装置のレーザダイオード以外の負荷であってもよい。
Also, the
10A,10B スイッチング電源装置
11 駆動回路部
12 スイッチング回路部
13 フィルタ回路部
14A,14B,14C 制御回路部
15 電流検出部
16 比較部
17 RSフリップフロップ部
18 駆動部
19 遅延部
20 ヒステリシス付き比較部
30 負荷
AMP1 差動増幅器
AMP2 差動増幅器
BUF 論理肯定器
COMP1 第1比較器
COMP2 第2比較器
INV 論理否定器
OR1 第1論理和器
OR2 第2論理和器
Q1 高電位側スイッチング素子
Q2 低電位側スイッチング素子
10A, 10B switching
Claims (3)
前記高電位側スイッチング素子をオン/オフさせるための第1駆動信号および前記低電位側スイッチング素子をオン/オフさせるための第2駆動信号を出力する、ブートストラップ機能付きの駆動回路部と、
前記負荷に流れている電流に基づいて、前記第1駆動信号の元になる第1制御信号および前記第2駆動信号の元になる第2制御信号を前記駆動回路部に与える制御回路部と、
を備え、
前記制御回路部には、イネーブル信号と、前記電流の上限値および下限値の両方に関係する1つの外部設定信号とが外部から与えられ、
前記制御回路部は、
(1)前記イネーブル信号が第1状態であるときに、前記電流が前記上限値を上回ろうとすると、前記第1制御信号および前記第2制御信号によって前記高電位側スイッチング素子がオフし、かつ前記低電位側スイッチング素子がオンした第1スイッチ状態を作り出し、前記電流が前記下限値を下回ろうとすると、前記第1制御信号および前記第2制御信号によって前記高電位側スイッチング素子がオンし、かつ前記低電位側スイッチング素子がオフした第2スイッチ状態を作り出し、
(2)前記イネーブル信号が前記第1状態とは異なる第2状態であるときに、前記第1制御信号および前記第2制御信号によって前記電流とは無関係に前記第1スイッチ状態を作り出す
ことを特徴とするスイッチング電源装置。 A switching power supply device that drives a load by an N-type high-potential side switching element and an N-type low-potential side switching element connected in series,
a drive circuit unit with a bootstrap function that outputs a first drive signal for turning on/off the high potential side switching element and a second drive signal for turning on/off the low potential side switching element;
a control circuit unit that provides the drive circuit unit with a first control signal that is the source of the first drive signal and a second control signal that is the source of the second drive signal, based on the current flowing through the load;
with
The control circuit unit is externally provided with an enable signal and one external setting signal related to both the upper limit value and the lower limit value of the current,
The control circuit unit
(1) when the current is about to exceed the upper limit when the enable signal is in the first state, the high potential side switching element is turned off by the first control signal and the second control signal; creating a first switch state in which the low potential side switching element is turned on, and when the current tends to fall below the lower limit value, the high potential side switching element is turned on by the first control signal and the second control signal; and creating a second switch state in which the low potential side switching element is turned off,
(2) The first switch state is created independently of the current by the first control signal and the second control signal when the enable signal is in a second state different from the first state. and switching power supplies.
前記外部設定信号の分圧により、前記上限値に対応する上限設定信号および前記下限値に対応する下限設定信号を生成する上下限信号生成部と、
前記電流に応じた電流検出信号を出力する電流検出部と、
前記上限設定信号と前記電流検出信号とを比較するとともに該比較の結果に応じた第1比較結果信号を出力する第1比較部と、
前記下限設定信号と前記電流検出信号とを比較するとともに該比較の結果に応じた第2比較結果信号を出力する第2比較部と、
前記第1比較結果信号および前記第2比較結果信号のうちの一方がセット信号として入力されるとともに他方がリセット信号として入力されるRSフリップフロップ部と、
を備え、
前記RSフリップフロップ部が出力するQ信号および反転Q信号のうちの一方が前記第1制御信号として前記駆動回路部に与えられるとともに他方が前記第2制御信号として前記駆動回路部に与えられる
ことを特徴とする請求項1に記載のスイッチング電源装置。 The control circuit unit
an upper/lower limit signal generation unit that generates an upper limit setting signal corresponding to the upper limit value and a lower limit setting signal corresponding to the lower limit value by dividing the voltage of the external setting signal;
a current detection unit that outputs a current detection signal corresponding to the current;
a first comparison unit that compares the upper limit setting signal and the current detection signal and outputs a first comparison result signal according to the result of the comparison;
a second comparison unit that compares the lower limit setting signal and the current detection signal and outputs a second comparison result signal according to the result of the comparison;
an RS flip-flop section to which one of the first comparison result signal and the second comparison result signal is input as a set signal and the other is input as a reset signal;
with
One of the Q signal and the inverted Q signal output from the RS flip-flop section is applied to the drive circuit section as the first control signal, and the other is provided to the drive circuit section as the second control signal. 2. The switching power supply device according to claim 1.
前記Q信号および前記反転Q信号の代わりに、前記遅延Q信号および前記遅延反転Q信号が前記駆動回路部に与えられる
ことを特徴とする請求項2に記載のスイッチング電源装置。 The control circuit unit further includes a delay unit that generates a delayed Q signal by delaying the rising of the Q signal and generates a delayed inverted Q signal by delaying the rising of the inverted Q signal,
3. The switching power supply device according to claim 2, wherein the delayed Q signal and the delayed inverted Q signal are applied to the drive circuit section instead of the Q signal and the inverted Q signal.
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Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5408150A (en) | 1992-06-04 | 1995-04-18 | Linear Technology Corporation | Circuit for driving two power mosfets in a half-bridge configuration |
JP2006254588A (en) | 2005-03-10 | 2006-09-21 | Fujitsu Ltd | Control circuit and control method of current mode control type dc-dc convertor |
US20100013452A1 (en) | 2008-07-18 | 2010-01-21 | Primarion, Inc. | Methods and apparatus for power supply load dump compensation |
JP2010200554A (en) | 2009-02-26 | 2010-09-09 | Fuji Electric Systems Co Ltd | Dc-dc converter |
JP2018102053A (en) | 2016-12-20 | 2018-06-28 | 株式会社小糸製作所 | Converter controller and vehicular lighting fixture |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6382002B2 (en) * | 2014-07-11 | 2018-08-29 | ローム株式会社 | DC-DC converter |
JP6396160B2 (en) * | 2014-10-02 | 2018-09-26 | 株式会社小糸製作所 | Vehicle lamp and its lighting circuit |
JP6943650B2 (en) * | 2017-07-07 | 2021-10-06 | ローム株式会社 | High-side transistor drive circuit, DC / DC converter control circuit using it, DC / DC converter |
-
2019
- 2019-06-12 JP JP2019109668A patent/JP7174672B2/en active Active
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5408150A (en) | 1992-06-04 | 1995-04-18 | Linear Technology Corporation | Circuit for driving two power mosfets in a half-bridge configuration |
JP2006254588A (en) | 2005-03-10 | 2006-09-21 | Fujitsu Ltd | Control circuit and control method of current mode control type dc-dc convertor |
US20100013452A1 (en) | 2008-07-18 | 2010-01-21 | Primarion, Inc. | Methods and apparatus for power supply load dump compensation |
JP2010200554A (en) | 2009-02-26 | 2010-09-09 | Fuji Electric Systems Co Ltd | Dc-dc converter |
JP2018102053A (en) | 2016-12-20 | 2018-06-28 | 株式会社小糸製作所 | Converter controller and vehicular lighting fixture |
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